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China genehmigt AMDs Übernahme von Xilinx unter 5 Bedingungen!

Am 27. Oktober 2020 gab AMD bekannt, dass es Xilinx (Xilinx) für 35 Milliarden US-Dollar im Rahmen eines All-Stock-Deals übernehmen wird.Der Deal wurde zwar von den Vorständen beider Parteien einstimmig genehmigt, muss jedoch noch von den Aktionären beider Parteien genehmigt werden, wobei die behördliche Zustimmung verschiedener Länder, darunter natürlich auch China, erforderlich ist.

Kürzlich gab das Antimonopolamt der staatlichen Marktaufsichts- und Verwaltungsbehörde Chinas die Entscheidung bekannt, die Antimonopolprüfung des Erwerbs einer Beteiligung an Xilinx durch die Chaowei Semiconductor Corporation mit zusätzlichen restriktiven Bedingungen zu genehmigen (die „Ankündigung“) die Übernahme von Xilinx durch AMD und die Überwindung der letzten regulatorischen Hürde für die Übernahme.

Der Ankündigung zufolge hat die General Administration of Market Regulation ein Jahr nach Erhalt der Antimonopol-Betreiberkonzentrationserklärung im Fall der Übernahme von Xilinx durch AMD am 19. Januar 2021 und der Einreichung des Falls, nachdem der Antragsteller seine Erklärungsmaterialien ergänzt hatte (GAMR) hat beschlossen, den Fall mit restriktiven Auflagen zu genehmigen.

Fusionen sind erlaubt, aber keine Bündelverkäufe oder Diskriminierung chinesischer Kunden

Es ist wichtig zu verstehen, dass Akquisitionen mit grenzüberschreitendem Betrieb einer behördlichen Genehmigung mehrerer wichtiger Marktregulierungsbehörden auf der ganzen Welt bedürfen.Zuvor hatten die USA, das Vereinigte Königreich und die EU die Übernahme bereits genehmigt, und da China dem Fall nun zugestimmt hat, bedeutet dies, dass AMD seine Übernahmepläne im ersten Quartal 2022 abschließen kann.

Es ist jedoch zu beachten, dass die Genehmigung der Übernahme von Xilinx durch AMD durch die chinesische General Administration of Market Regulation mit zusätzlichen restriktiven Bedingungen verbunden ist, die beide Parteien der Transaktion und das nach dem Zusammenschluss entstehende Unternehmen dazu verpflichten, die folgenden Verpflichtungen zu erfüllen.

(i) Beim Verkauf von SuperPower-CPUs, SuperPower-GPUs und Celeris-FPGAs auf dem Markt in China dürfen sie in keiner Weise Kopplungsverkäufe erzwingen oder andere unangemessene Handelsbedingungen anhängen;Sie dürfen Kunden nicht daran hindern oder einschränken, die oben genannten Produkte einzeln zu kaufen oder zu verwenden.und sie dürfen Kunden, die die oben genannten Produkte einzeln kaufen, nicht in Bezug auf Serviceniveau, Preis, Softwarefunktionen usw. diskriminieren.

(b) Die relevante Zusammenarbeit auf der Grundlage der bestehenden Zusammenarbeit mit Unternehmen in China weiter fördern und weiterhin Chaowei-CPUs, Chaowei-GPUs, Xilinx-FPGAs sowie zugehörige Software und Zubehör an den Markt in China liefern, wobei die Grundsätze der Fairness, Angemessenheit und Nicht-Verletzung einzuhalten sind. Diskriminierung.

(iii) Gewährleistung der Flexibilität und Programmierbarkeit der Xilinx-FPGAs, Weiterentwicklung und Sicherstellung der Verfügbarkeit der Xilinx-FPGA-Produktlinie sowie Sicherstellung, dass sie in einer Weise entwickelt wird, die mit ARM-basierten Prozessoren kompatibel ist und mit den Plänen von Xilinx vor der Transaktion übereinstimmt .

(iv) weiterhin die Interoperabilität der auf dem chinesischen Markt verkauften Chaowei-CPUs, Chaowei-GPUs und Celeris-FPGAs mit CPUs, GPUs und FPGAs von Drittanbietern sicherzustellen;Das oben genannte Maß an Interoperabilität darf nicht niedriger sein als das Maß an Interoperabilität von Chaowei-CPUs, Chaowei-GPUs und Celeris-FPGAs.Informationen, Funktionen und Beispiele im Zusammenhang mit dem Interoperabilitäts-Upgrade müssen dem Dritten innerhalb von 90 Tagen nach dem Upgrade bereitgestellt werden. CPU-, GPU- und FPGA-Hersteller.

(v) Maßnahmen ergreifen, um die Informationen der CPU-, GPU- und FPGA-Dritthersteller zu schützen und Vertraulichkeitsvereinbarungen mit den CPU-, GPU- und FPGA-Drittherstellern abzuschließen;Speichern Sie die vertraulichen Informationen der CPU-, GPU- und FPGA-Dritthersteller in separaten und sich gegenseitig ausschließenden Hardwaresystemen.